DE2536270A1 - Mii oeffnungen versehene halbleiterscheibe - Google Patents
Mii oeffnungen versehene halbleiterscheibeInfo
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- 239000004065 semiconductor Substances 0.000 title claims description 43
- 239000000758 substrate Substances 0.000 claims description 13
- 239000004020 conductor Substances 0.000 claims description 3
- 239000012811 non-conductive material Substances 0.000 claims 1
- 235000012431 wafers Nutrition 0.000 description 37
- 239000000463 material Substances 0.000 description 3
- KRHYYFGTRYWZRS-UHFFFAOYSA-N Fluorane Chemical compound F KRHYYFGTRYWZRS-UHFFFAOYSA-N 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 239000004593 Epoxy Substances 0.000 description 1
- MMOXZBCLCQITDF-UHFFFAOYSA-N N,N-diethyl-m-toluamide Chemical compound CCN(CC)C(=O)C1=CC=CC(C)=C1 MMOXZBCLCQITDF-UHFFFAOYSA-N 0.000 description 1
- 239000002253 acid Substances 0.000 description 1
- 229910010293 ceramic material Inorganic materials 0.000 description 1
- 238000004891 communication Methods 0.000 description 1
- 238000009429 electrical wiring Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 230000005496 eutectics Effects 0.000 description 1
- 239000011521 glass Substances 0.000 description 1
- 150000002344 gold compounds Chemical class 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 238000004806 packaging method and process Methods 0.000 description 1
- 229920002120 photoresistant polymer Polymers 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
- 238000005476 soldering Methods 0.000 description 1
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- H—ELECTRICITY
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- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/42—Wire connectors; Manufacturing methods related thereto
- H01L24/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L24/49—Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
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- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/0657—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions characterised by the shape of the body
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/4805—Shape
- H01L2224/4809—Loop shape
- H01L2224/48091—Arched
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/48235—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a via metallisation of the item
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- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/484—Connecting portions
- H01L2224/4845—Details of ball bonds
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- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/49—Structure, shape, material or disposition of the wire connectors after the connecting process of a plurality of wire connectors
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- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/42—Wire connectors; Manufacturing methods related thereto
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- H01L2924/0001—Technical content checked by a classifier
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- H01L2924/01006—Carbon [C]
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- H01L2924/01—Chemical elements
- H01L2924/01014—Silicon [Si]
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01015—Phosphorus [P]
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- H01L2924/01—Chemical elements
- H01L2924/01019—Potassium [K]
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01039—Yttrium [Y]
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- H01L2924/01—Chemical elements
- H01L2924/01079—Gold [Au]
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/0132—Binary Alloys
- H01L2924/01322—Eutectic Alloys, i.e. obtained by a liquid transforming into two solid phases
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- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/014—Solder alloys
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- H01L2924/09701—Low temperature co-fired ceramic [LTCC]
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Description
Boblinien, den 13. August 1975
ne-fe
Anmelderin: International Business -lachinea
Corporation, Armonk, N.Y. 10504
Amtliches Aktenzeichen: Neuanmeldung Aktenseichen der Anmelderin: PI 973 102
Die Erfindung bezieht sich auf Halbleiterscheiben oder Substrate, auf denen eine Reihe von Halbleiterplättchen mit integrierter
'. Schaltung angeordnet werden kann.
J Beim Packen von Halbleiterscheiben besteht ein Interesse an ; samer Kommunikation mit den Schaltungen, die nahe dem Mittelpunkt
j der Halbleiterscheibe angeordnet sind. Bei Speieheranwendungen
stellt die sorgfältige Anordnung der Schaltung sicher, daß die meisten oder alle Schaltungen, die mit Schaltungen außerhalb der
Halbleiterscheibe in Verbindung stehen, sich nahe dem Rand der Halbleiterscheibe befinden. Dies kann jedoch nicht leicht erreicht
werden für Halbleiterscheiben mit bool'sehen Schaltungen, da die
Anordnungen mehr stochastischer Natur sind. Daher war es in der Vergangenheit notwendig, relativ lange Drähte über die Oberfläche
der Halbleiterscheibe zu Mehrfachanschlußstellen zu führen, die vom Umfang der Halbleiterscheibe entfernt waren. Der Nachteil
dieser Lösung ist die Anfälligkeit solch langer Drähte gegenüber Beschädigungen. Der Durchmesser der Drähte muß notwendigerweise
.beträchtlich sein, wodurch beim Bonden von Drähten, die einen großen
Querschnitt aufweisen, Probleme geschaffen werden. Darüberhinaus bedingt die nahe Lage der langen Drähte über der Oberfläche
der Halbleiterscheiben Störungen hinsichtlich der Untersuchung der Oberfläche oder der Ausbesserung der Halbleiter-plättchen.
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Der Erfindung liegt daher die Aufgabe zugrunde, die elektrische Verdrahtung der auf einer Halbleiterscheibe befindlichen monolithisch
integrierten Schaltungen, die mit Schaltungen außerhalb der Halbleiterscheibe in Verbindung stehen, zu verbessern.
Diese Aufgabe wird gelöst durch eine Halbleiterscheibe, die dadurch
gekennzeichnet ist, daß sie in ihrem inneren Bereich mindestens eine öffnung aufweist und dadurch kürzere Verbindungsdrähte
in den vom Scheibenrand weiter entfernten integrierten Schaltungen ermöglicht.
Im folgenden wird die Erfindung durch die genaue Beschreibung eines bevorzugten Ausführungsbeispieles in Verbindung mit den
Zeichnungen näher erläutert, von denen zeigen:
Fif;. 1 eine perspektivische Ansicht einer mit einer
öffnung versehenen Halbleiterscheibe, die auf einem Substrat montiert ist und Drahtverbindungen
zwischen der Oberfläche der Halbleiterscheibe und der Oberfläche des Substrates aufweist.
Fig. 2 ein teilweiser Querschnitt durch die mit einer
öffnung versehene Halbleiterscheibe nach Fig. 1, der ausgewählte Drahtverbindungen zwischen der
Halbleiterscheibe und dem Substrat durch eine öffnung in der Halbleiterscheibe zeigt.
Fig. 3 eine Draufsicht auf eine modifizierte, eine öff
nung aufweisende Halbleiterscheibe, bei der die Drahtverbindungen nicht dargestellt sind.
Fig. 4 eine Draufsicht auf eine andere modifizierte
Halbleiterscheibe, die eine Reihe von öffnungen
aufweist und bei der ebenfalls die Drähte fort-
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- 3 gelassen sind.
j Die in Fig. 1 dargestellte kreisförmige Halbleiterscheibe 10 Ist
mit einer rechteckigen Öffnung 12 versehen, die im wesentlichen in der Mitte der Halbleiterscheibe angebracht ist. Die Halbleiterscheibe
10 kann ein Halbleitersubstrat aus Silicium oder der- * gleichen sein, In der eine Reihe von aktiven und passiven HaIb-
: leiterschaltungen gebildet wurde.
; Die Öffnung 12 kann durch verschiedene Verfahren gebildet werden,
wie z.B. durch Ätzen von beiden Seiten mit einer Mischung aus SaI-j
petersäure und Flußsäure, wobei ein Photoresist als Maske benutzt i
wird oder durch schleifendes Schneiden mit einer Schneidmaschi- :
! ne oder durch Herstellen eines Loches oder des Lochrandes mit HiI-J
fe eines Lasers.
\ Wie in den Fign. 3 und 4 dargestellt ist, kann der äußere Rand der;
Halbleiterscheiben 10' und 10" als auch die Form der Öffnung !
: 12' auch eine andere Konfiguration aufweisen und eine Reihe von J
Öffnungen 12" kann auch in der Halbleiterscheibe vorgesehen ■ werden, abhängig von den besonderen Erfordernissen der Schaltung,
j Eine integrierte Schaltung ist bei lh dargestellt und zwei aus
! einer Reihe von Spannungsverteilungsdrähten 16, die sich über den äußeren Umfang der Halbleiterscheibe hinauserstrecken und durch
die Öffnung 12 sind mit der Schaltung 14 verbunden^
In dem dargestellten Beispiel fällt das Vorhandensein der Öffnung 12 in der Mitte der kreisförmigen Halbleiterscheibe 10 in die
Hälfte des Abstandes, den eine Schaltung im ungünstigsten Fall vom Rand einer Halbleiterscheibe ohne Öffnung aufweist. Obgleich
als Folge der Öffnung eine leichte Verringerung des verfügbaren Raumes auf der Halbleiterscheibe resultiert, gibt es einen entsprechenden
Zuwachs in der Anzahl der Ein- und Ausgänge der Halbleiterscheibe. Wenn beispielsweise die Öffnung 12 ein kreisförmiges Loch mit einem Durchmesser von 0,62 cm aufweist und der Durch·
messer der Halbleiterscheibe 10,5 cm beträgt, würde die verfüg-
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bare Halbleiterfläche um 0,6% abnehmen. Die größte Entfernung des
ungünstigsten Punktes auf der Halbleiterscheibe von einem Rand
würde jedoch abnehmen von 4 cm auf 2cm. Die Anzahl der Eingänge und Ausgänge der Halbleiterscheibe würde jedoch, wenn man einen
mittleren Abstand der Eingangs- und Ausgangskontaktflecken 18 von 0,5 cm annimmt, von 510 auf 549 steigen. Die Eingangs/Ausgangsverbindungen
werden durch Thermokompression oder andere bekannte Technologien hergestellt.
Obgleich dieses Verfahren dazu benutzt werden kann, den Abstand zum Rand weiter zu verringern oder mehr Eingangs-Ausgangsmöglichkeiten
vorzusehen durch Hinzufügen von vier öffnungen in verschie·
denen Mustern, ergibt eine einzige öffnung in der Mitte den größten
Gewinn pro Loch mit gleicher Fläche.
Das Substrat 20 ist in Fig. 2 im Querschnitt gezeigt. Das Substra
20 kann aus mehreren Schichten keramischen Materials oder Epoxyglas
bestehen, in dem Schichten aus leitfähigem Material 22 mit isolierenden Schichten 24 abwechseln, um das Substrat zu bilden.
Eine Reihe von öffnungen 26 erstrecken sich durch das Substrat
zu der gewünschten leitfähigen Schicht 22 und geeignete elektrische Verbindungsglieder 30 erstrecken sich durch die Löcher hindurch
zwischen.der leitfähigen Schicht und den Kontaktflecken 28 auf der Oberfläche des Substrates. Die Halbleiterscheibe 10 soll
einen guten wärmeleitenden Kontakt mit dem Substrat 20 haben und kann, um das zu erreichen, durch eine eutektische Goldverbindung,
durch Löten oder durch ein wärmeleitfähiges plastisches Material, das schematisch bei 40 gezeigt ist, mit dem Substrat 20 befestigt
werden. Das Verbindungsmaterial 40 ist in übertriebener Dicke dargestellt und in der Praxis würde die Halbleiterscheibe
10 nur von dem Substrat durch eine dünne Schicht des Verbindungsmaterials getrennt sein.
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Claims (5)
- - 5 P Λ T E N T A N S P R Ü C H E.. - Halbleiterscheibe zur Unterbringung einer Reihe von inte- >—' grierten Schaltungen auf einer ihrer Oberflächen, dadurch gekennzeichnet, daß sie in ihrem inneren Bereich mindestens eine öffnung (12, Pig. I) aufweist und dadurch kürzere Verbindungsdrähte zu den vom Scheibenrand weiter entfernten integrierten Schaltungen ermöglicht.
- 2. Halbleiterscheibe nach Anspruch I3 dadurch gekennzeichnet, daß sie und ihre öffnung kreisförmig ausgebildet ist.
- 3. Halbleiterscheibe nach Anspruch I3dadurch gekennzeichnet, daß sie kreisförmig und ihre Öffnung rechtwinklig ausgebildet ist.
- 4. Halbleiterscheibe nach Anspruch 1,dadurch gekennzeichnet, daß sie mehrere öffnungen aufweist!.
- 5. Halbleiterscheibe nach Anspruch 1,dadurch gekennzeichnet, daß sie auf einem mehrlagigen Substrat montiert ist, dessen Schichten abwechselnd aus nichtleitendem und leitendem Material bestehen, und daß die integrierten Schaltungen selektiv mit den leitenden Schichten über die Scheibenöffnung oder den Scheibenrand verbunden sind.PI 973 102609810/0650Leerseite
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US05/498,342 US3959579A (en) | 1974-08-19 | 1974-08-19 | Apertured semi-conductor device mounted on a substrate |
Publications (1)
Publication Number | Publication Date |
---|---|
DE2536270A1 true DE2536270A1 (de) | 1976-03-04 |
Family
ID=23980676
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE19752536270 Withdrawn DE2536270A1 (de) | 1974-08-19 | 1975-08-14 | Mii oeffnungen versehene halbleiterscheibe |
Country Status (6)
Country | Link |
---|---|
US (1) | US3959579A (de) |
JP (1) | JPS5250512B2 (de) |
DE (1) | DE2536270A1 (de) |
FR (1) | FR2282719A1 (de) |
GB (1) | GB1469085A (de) |
IT (1) | IT1039025B (de) |
Families Citing this family (34)
Publication number | Priority date | Publication date | Assignee | Title |
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-
1974
- 1974-08-19 US US05/498,342 patent/US3959579A/en not_active Expired - Lifetime
-
1975
- 1975-05-20 GB GB2162575A patent/GB1469085A/en not_active Expired
- 1975-06-17 IT IT24418/75A patent/IT1039025B/it active
- 1975-07-03 FR FR7521475A patent/FR2282719A1/fr active Granted
- 1975-07-15 JP JP50085922A patent/JPS5250512B2/ja not_active Expired
- 1975-08-14 DE DE19752536270 patent/DE2536270A1/de not_active Withdrawn
Also Published As
Publication number | Publication date |
---|---|
GB1469085A (en) | 1977-03-30 |
FR2282719A1 (fr) | 1976-03-19 |
IT1039025B (it) | 1979-12-10 |
JPS5250512B2 (de) | 1977-12-24 |
FR2282719B1 (de) | 1977-07-22 |
JPS5136083A (de) | 1976-03-26 |
US3959579A (en) | 1976-05-25 |
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